AMDの次世代APU/CPU/SoCについて語ろう 289世代

1 ：Socket774 ：2018/01/19(金) 11:34:18.82 ID:ji3xbfoR0.net

＿＿＿
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前スレ
AMDの次世代APU/CPU/SoCについて語ろう 288世代
https://egg.5ch.net/test/read.cgi/jisaku/1515306136/

---

VIPQ2_EXTDAT: default:vvvvvv:1000:512:----: EXT was configured

736 ：Socket774 ：2018/02/16(金) 12:41:23.19 ID:FDKYPJEc0.net

>>733
現行zenのCCXは4コアでそれを2つ搭載しての8コア
EPYCのMCM実装を見ると4チップが限度な気もするから
CCXを6コアに増やして1チップ当たりのコア数を増やすのはあり得ると思う
前にこういう話をしたときは同一ダイによる歩留まりの高さを手放すわけがないとも言われ
それももっともだなと思ったけど

737 ：Socket774 ：2018/02/16(金) 12:45:15.87 ID:IphnPoRV0.net

Zen+マシンをZen2に載せ替えるってできるの？

738 ：Socket774 ：2018/02/16(金) 12:52:43.43 ID:gJbf5XTA0.net

>>736
単純計算でコア間を接続するのに2コアなら1本、3コアなら3本、4コアなら6本のバスが必要
5コアなら10本で6コアなら15本も必要になる
だから緊密な接続をするコアの単位を4にして
そのかたまりを新設計した汎用バスで接続するのがトランジスタの節約手段なわけで
それがZenのリングバスと比べて革新的な所なんだから
今更CCX内の接続を増やすこともないだろう
2コア増やすのにバスが倍以上になるんだし
IFのクロックを上げるなどしてCCXそのものの数を増やす方がいいんじゃね

739 ：Socket774 ：2018/02/16(金) 13:04:37.97 ID:K1C9aUaR0.net

>>738
……と、自分も思ってたんで実際ありえんだろと思ったんだけど、そのCCX内部でコア間相互に
直接バス接続してるんだっけ？って疑問がでて今色々調べてるんだけどよく分からん。

L3介してでしか繋がってないのならそもそも心配する話でも無いんだよなこれ。
何か資料無い？

740 ：Socket774 ：2018/02/16(金) 13:20:08.95 ID:gJbf5XTA0.net

>>739
共有ではあるがコアの数だけ分けられているので
そのあたりで何かミソがあるんだろう
http://www.4gamer.net/games/300/G030061/20170228119/SS/014.jpg

741 ：Socket774 ：2018/02/16(金) 13:36:18.93 ID:VrUFd6nQr.net

>>737
ソケットの事なら、一応はZEN2まではAM4

742 ：Socket774 ：2018/02/16(金) 13:57:38.95 ID:Yv2kT3bK0.net

今のオンダイIFの仕様だとCCX間接続での帯域足りないからCCX数自体を増やすのは厳しい
48コアCPUなら現行のソケットで対応することになるだろうし、互換の面も考えるとInfinity Fabric周りには手は入らないかと思われる
メインストリームも6コアになるだろうし、1CCXを6コアにするのは妥当な方針

743 ：Socket774 ：2018/02/16(金) 14:30:38.86 ID:baD1clRFM.net

Ryzenの弱点だったメモリレイテンシがAPU版Ryzen 2400Gで相当改善　シーケンシャルではIntelを凌駕　フルランダムでIntelに10ns差まで詰める　いいよいいよ〜！　
https://t.co/XHpGc6Ddxv https://t.co/wU3kZVvaN0 👀
Rock54: Caution(BBR-MD5:b73a9cd27f0065c395082e3925dacf01)

744 ：Socket774 ：2018/02/16(金) 14:32:35.33 ID:acubGOMy0.net

このスレ読んで1600X買いました

745 ：Socket774 ：2018/02/16(金) 14:44:27.68 ID:LR7lQInj0.net

メモリ周りが改善されれば、あとインテルに追いついてほしい機能は、クロック制御と温度管理含むだな
これがもう何世代分か進めばインテルとほぼ差がなくなる、AVXはどうしようもないと思うが

746 ：Socket774 ：2018/02/16(金) 14:56:30.74 ID:k9sJMcWgp.net

>>735
AVXもZen2ではIntelを超えてくるよ

747 ：Socket774 ：2018/02/16(金) 15:02:01.61 ID:gJbf5XTA0.net

それを言うならドラスティックだろ

748 ：Socket774 ：2018/02/16(金) 15:04:48.26 ID:orQZKSdD0.net

>>742
CCX間の接続は共有バスとは思えないので帯域の問題は無いでしょ
7nmのAPUは予定だと4C/8Tだし4コアCCXを継続すると思うけどね

749 ：Socket774 ：2018/02/16(金) 15:12:27.62 ID:GG1+OzfR0.net

実際AVX256はCPUでのH265エンコで有効だから
これ業界で普通の256bitSIMDですから（ぶっちゃけ互換だけどねｗ）とか言ってちゃんと実装してくるかもしれない

750 ：Socket774 ：2018/02/16(金) 15:24:50.35 ID:gJbf5XTA0.net

AVX256はRyzenでも使えるでしょ
128bitを2本束ねて使う以上
2本が空いた状態でないと走らせられない待機時間がネックになっているだけで
Zen2でユニットを増量して256bit2本か3本にするのかわからんけど

751 ：Socket774 ：2018/02/16(金) 17:06:50.05 ID:Nj0EJ5J5a.net

>>749
H265とかGPUにまかせればいい

752 ：Socket774 ：2018/02/16(金) 17:12:22.84 ID:FDKYPJEc0.net

>>738
それはバランスの問題でなかろうか
1ダイあたりの搭載CCXを（コア数は4のまま）増やしてもCCX間接続用のバスの増強・増設は必要になるし
Ryzen5〜7にみるCCX間アクセスのペナルティーの存在なども考えると・・

753 ：Socket774 ：2018/02/16(金) 17:39:49.18 ID:h8yXKQXXM.net

2400Gはビデオカードさした時の性能が今ひとつなのが気になる
APU特有の問題だといいんだけど。

754 ：Socket774 ：2018/02/16(金) 18:03:52.44 ID:tYeblkEr0.net

>>742
現時点ですらCPUダイ内部と外部でInfinity Fabricの仕様は異なるのに、何故内部Infinity Fabricに手を加えたら互換性に問題が出ると思うのか

755 ：Socket774 ：2018/02/16(金) 18:06:16.32 ID:Jx1Xf8SEp.net

>>737
出来るよ！

756 ：Socket774 ：2018/02/16(金) 18:07:43.87 ID:tYeblkEr0.net

>>753
鰤も含めたAM4 APUはGPU用PCI-Expressが8レーンしか無いねん

757 ：Socket774 ：2018/02/16(金) 18:13:01.62 ID:QTcPKhdQp.net

Ryzenの弱点だったメモリレイテンシがAPU版Ryzen 2400Gで相当改善　シーケンシャルではIntelを凌駕　
フルランダムでIntelに10ns差まで詰める。
https://t.co/XHpGc6Ddxv https://t.co/wU3kZVvaN0 👀

ZEN+向けの改良が一足先に採用されてるんで、ZEN+はクロック上昇分+αの性能向上が見込める！
　,､
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.ﾉ 甲ﾉ　
/　ωゝ
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──勝利の剣！！」 👀
Rock54: Caution(BBR-MD5:b73a9cd27f0065c395082e3925dacf01)

758 ：Socket774 ：2018/02/16(金) 18:22:31.50 ID:ADdioTTO0.net

そもそもInfinityFabricは商標みたいなもんで
中身のSCF/SDFが問題だろ
そしてCCX内はFCトポロジ/クロスバでSDFではない

759 ：Socket774 ：2018/02/16(金) 18:24:44.73 ID:FDKYPJEc0.net

>>754
現行のIFシステムは32コアまでしか識別できないと団子が息巻いてたから、それ関連のことでは
システムファームのアップデートで対応できるのかは知らない

760 ：Socket774 ：2018/02/16(金) 18:48:28.12 ID:ADdioTTO0.net

>>759
一応F17hB1時点でソケットに1ビット、ノードに2ビット、CCX識別に1ビット、コア(スレッド含む)識別に3ビット
つまり計128識別とPPRに書いて有るけどな
最大フィジカル255とも書いて有るから何処に割り込ませるかだな

つーかCCX内増やすとL3がキツイだろ、6x6ノード化した上でその各L2のタグを保持しつつ6C分のアクセスが有る
こういう設計をしたくないからCCXみたいなモジュール化をしたわけで

761 ：Socket774 ：2018/02/16(金) 19:38:57.42 ID:P2ekmKxor.net

>>749
https://pc.watch.impress.co.jp/img/pcw/docs/1047/474/html/l04.png.html
AVX2無効の 1800Xと AVX2有効の 5960Xが同じ速度
AVX2を増強するよりも物理的にコア増やした方が速い

762 ：Socket774 ：2018/02/16(金) 20:32:00.55 ID:k9sJMcWgp.net

いやドラマチックは劇的と言う使い方してるから

763 ：Socket774 ：2018/02/16(金) 21:43:36.23 ID:FDKYPJEc0.net

>>760
CCX識別に1ビットって2つまでなんじゃ？

764 ：Socket774 ：2018/02/16(金) 21:46:00.68 ID:2RmnT3I6a.net

>>763
それを言い出すと、CCX内は3bitなので8スレッドが上限になる
どちらにせよコアを増やすなら拡張するしかない

765 ：Socket774 ：2018/02/16(金) 21:52:50.56 ID:hdeRCH5U0.net

CCXの中増やすのとCCXの数増やすのってそんなに事情が違うん？
合計同じコア数ならどう割り振っても結局同じでは？

766 ：Socket774 ：2018/02/16(金) 21:56:34.76 ID:FDKYPJEc0.net

だから（というには、そのへんに言及してないけど）デスクトップ向けzen2は8コアのままコスト削減
サーバーのEpyc向けに6コアCCX x2でコア数アップ（大きさは今のRyzen7と同じぐらい）じゃないかなって思ってる

>>765
>729の解説記事にあるCCX間のデータの流れを見たら凄いことになってる

767 ：Socket774 ：2018/02/16(金) 22:09:43.39 ID:2RmnT3I6a.net

>>766
ダイのバリエーションもCCXのバリエーションも最小限に押さえる戦略だと思ってるので4コアCCX押しですわ

768 ：Socket774 ：2018/02/16(金) 22:47:51.56 ID:hdeRCH5U0.net

どちらにせよzen+では最低でも12c24t願わくば16c32t欲しいがな
あと空冷で

769 ：Socket774 ：2018/02/16(金) 23:23:05.09 ID:FDKYPJEc0.net

>>767
現14nm zenにおいてはもっとも良い戦略なのは異論なし
問題は6チップのMCM実装をどう考えるかかな、やっぱり　
あくまで4コア単位での並列性を重視するならCCXは4コアのままでいいだろうけど
トータル性能を高めてより高価格帯にねじ込みたいなら6コアCCXもありえそうだし・・
ま、団子なら4コア6コアになったところで想定市場は広がらねーよって高笑いするだろうけど

770 ：Socket774 ：2018/02/16(金) 23:42:08.41 ID:uTb1kkg9d.net

>>729
Zen2がCCX6coreでZen3がCCX8coreかな？
Zen2がCCX8coreなら相当胸熱だが

771 ：Socket774 ：2018/02/16(金) 23:46:09.38 ID:xgPfEFFC6.net

>>770
それCCXの利点完全に潰してるから流石に数年ではありえん
あっても6CCX×3

772 ：Socket774 ：2018/02/16(金) 23:55:15.79 ID:HWF28i790.net

CCXを6コアにする、ってのはコア間接続の配線が大変になるだろう。
K10で6コアを出したときも、配線に苦労したらしい話を聞く。

やってやれないことは無いと思うが、それでもダイ面積が膨れる代償を払ってでもやるかというと、やらないだろうなって思う。
それやるぐらいなら、L2をコアごとに1MB、L3をCCXごとに16MBにするほうがマシって気もする。

773 ：Socket774 ：2018/02/17(土) 00:13:32.30 ID:ge6+JYXx0.net

infinity fabricの伸びしろはまだまだ分からんぞ
Hypertransportがそうであるように

774 ：Socket774 ：2018/02/17(土) 02:36:22.97 ID:45JMuwlV0.net

今の4C/CCXが配線のコストから考えた結果なんだとしたら、4CCX×3、×4の方が
現実味があるな。CCX間の配線には余力があるってことだから。

775 ：Socket774 ：2018/02/17(土) 05:10:17.22 ID:uxm5sPos0.net

2C/4T 384SP XFR AVX2有効
PenGdeクラスを蹂躙ができるからでしょ
192SPですらUHD630と同等の論理性能はあるはずで
PenGのHD610の倍の性能だしね

776 ：Socket774 ：2018/02/17(土) 09:07:23.71 ID:aBQ5vSBjd.net

>>759
団子が32までって言ってたんなら余裕でそれ以上いけるな
あいつはそりゃもう見事な逆神だからな 団子の逆をはってれば間違いない
おかげさまでちよっと懐が潤いましたw

777 ：Socket774 ：2018/02/17(土) 12:01:20.53 ID:BdkAAwxg0.net

vega11ってやっぱ発色ええの?

778 ：Socket774 ：2018/02/17(土) 12:05:05.38 ID:QTxRNnqNp.net

Intel14nm++のCoffee Lakeの6コアi5-8400 99ドルのRyzen 3 2200Gにすらダブルスコアのボロ負けじゃん

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_001_timespy_620x415.jpg

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_002_firestrike_620x450.jpg

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_003_skydiver_620x450.jpg

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_004_Cloudgate_620x415.jpg

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_005_uni_basic_620x450.jpg

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_010_mem_620x710.jpg

http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_005_uni_extreme_620x450.jpg
ドラクエ10
http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_006_dq_620x415.jpg
モンハン
http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_007_MHO_620x415.jpg
ファイファン14
http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_008_FF14_620x415.jpg
ファイファン15
http://www.gdm.or.jp/wp-content/uploads/2018/02/13/Ryzen_2000_G_009_FF15_620x305.jpg

Intel信者完全にオワタ＼(＾o＾)／

779 ：Socket774 ：2018/02/17(土) 12:39:38.89 ID:m+icZjXA0.net

>>778
勝負にならないという理由で省略されていたiGPU対決がついに出てしまったか…

780 ：Socket774 ：2018/02/17(土) 12:42:29.19 ID:0UL5SDp90.net

内蔵としては優秀ってだけで性能求める用途には相変わらず論外

781 ：Socket774 ：2018/02/17(土) 12:46:16.57 ID:VjYqjbMXp.net

>>766
そんな無駄な作り分けはしないでしょう。
デスクトップ向けは12コアのダイですね。
ZEN2世代では、こうなる。
雷禅7 12C24T
雷禅5 8C16T
雷禅3 4C8T

782 ：Socket774 ：2018/02/17(土) 12:58:44.61 ID:QTxRNnqNp.net

ファイファン15
ベンチマークスコアとプレイの目安
7000以上：非常に快適
5000〜6999：とても快適
3500〜4999：快適
2500〜3499：やや快適
2000〜2499：普通
1500〜1999：設定変更を推奨
1000〜1499：設定変更が必要
1000未満：動作困難

スコアからして
Ryzen 5 2400GとRyzen 3 2200Gだとやや快適な(快適に近い方)
i5-8400だと設定変更が必要(動作困難に近い方)
と言う事が分かる

783 ：Socket774 ：2018/02/17(土) 13:18:41.87 ID:ge6+JYXx0.net

5000出ていりゃプレイは普通にできるよ
人の多い町中や24人レイドで全員表示されんかもしれんけど
性能に応じて表示人数を増やそうとするんでよっぽどのハイエンドでも60fpsくらいまで落ちる
メインコンテンツの4人とか8人のパーティーでの戦闘は敵も味方も少ないんで余裕

784 ：Socket774 ：2018/02/17(土) 14:19:28.37 ID:HKImGztQ0.net

ZEN2の64コアEPYCはTDP上がるって話だからRyzen7に16コアが出ても125Wモデルとかだろうな。

785 ：Socket774 ：2018/02/17(土) 14:37:47.51 ID:wupgz1AN0.net

>>784
Zen2世代は48コアだろ

786 ：Socket774 ：2018/02/17(土) 14:39:15.59 ID:n2jsBBEB0.net

どこまで多コアになってゆくのか

787 ：Socket774 ：2018/02/17(土) 14:44:35.21 ID:QTxRNnqNp.net

Zen+ APUで8%性能が底上げ
グリスをはんだに変更でさらに8%クロックが底上げ
約16%性能が底上
そうなるとやや快適から快適に遊べるように変わる

IntelはIce Lake出してくるけど残念な事に10+はCoffee Lakeの14++より性能が落ちる
8%クロックダウンでコア数でカバー
8コアで48EU

788 ：Socket774 ：2018/02/17(土) 14:56:19.90 ID:HKImGztQ0.net

>>785
12コアダイ最大48コアモデルと16コアダイ最大64コアモデルの2種類あるって噂もあるんだよ。
で後者はTDPの上昇を許容しているって話。

789 ：Socket774 ：2018/02/17(土) 15:50:45.00 ID:a+oelB5Q0.net

12LPで14LPPからのスケールが下がるから、ここからzen2の7nmだとコスト増分考慮して12Cが妥当
ただAPUラインと完全に切り分ける事を考慮すべきなのとCCX内部の増加はやりたくない
コレを満たす最小の構成は4C/CCXのまま3CCXのCPUと1CCXのAPUに分ける事
APUラインの上限が4C、3CCXで2Cづつ無効化すると6C
で9C/12C(フル)
或いはCCXごと無効化すれば8Cに出来る(やらんと思うが、キャッシュ勿体無いから)
問題はメモリコントローラが2基固定って事だけど、もっといかれた構成やった事あるし大丈夫だろう
4CCX構成となると最小の半割で8C、APUラインを8C最大にすれば中間の穴埋めは可能だがイールド的に不安要素になる

もう一つ前々から考えてたんだが
CCXが4Cなのは単純な配線とキャッシュ構造の都合じゃないと思ってる
128x2のFP/SIMDユニットが4基、AVXが512迄
現行世代ではSSE特化と言っていい特性
GCN世代はNAVIが最後、現構成は32bitx64spのCU

790 ：Socket774 ：2018/02/17(土) 17:34:52.73 ID:PDNqynyZ0.net

うちのコードやっと4CCXに最適化したのに今度は6CCXとかコロコロ変えられたら困る
なんて怒られないかな？どれぐらいあるか知らないけど

791 ：Socket774 ：2018/02/17(土) 17:38:38.46 ID:t9OdPmq40.net

>>774
CCX間配線はいまの2CCXの時点で2CCXと同じぐらいあるから
CCX自体を増やすのは考えられないと思う
各CCXとの接続をリングバス的に接続するなら問題なさそうだけどダイサイズ的に無理そう

>>789
いよいよならCPUとGPUのMCMだってばよ
TSMCのCoWoSでCPU, GPU, HBM3を実装したAPUを期待して待とうぜ

792 ：Socket774 ：2018/02/17(土) 18:18:40.75 ID:m5IwP1ODa.net

>>791
ではCCXを6Cとした場合を考えてみるか
先ずスライスを1.5倍とするかブロックを1.5倍とするかだが
この場合アクセス数が増えるし、コリジョンの発生回数を低減する為にも当然スライスを増加させたい
となると犠牲になるのはレイテンシ
結果的に増加する平均レイテンシを下げる為に上位キャッシュを出来れば高容量化したい
が、CCXを複数搭載する関係上L2迄のタグを保持する事と、大容量化したL3間での共有/排他制御から容量効率と速度は悪化する
まぁ7nmである事を勘案すればできなくは無い面積だとは思うし、速度もクロック上げれば良いわな
その場合APUラインも6Cからになるけど、こっちはこっちで電力的にもコスト的にも微妙になる(対象の低価格帯/モバイル類としては高くなる)
APUラインはDDR4のみとサイドポート付きのバージョンを用意したいところではあるけど
このサイズだとコスト的に無理が出て来るのでDDR4のみの選択か
あとは電力制御単位の問題、CCXでレギュレートしているので当然粗くなるし、L3がCCX内で最速のコアに引き摺られる仕様もあるのでこのデカいL3はほぼ常時最高速
それから配線の肥大化を招くので下層を多目に見積もる必要がある、つまり面積の割には多少高価になる
まぁこんなところか

因みに内部SDFはクロスバって話だったが、コアと比して低速要求だからこっち増やすのは比較的楽

793 ：Socket774 ：2018/02/17(土) 18:27:18.90 ID:epgM/+6h0.net

なんか性能うんぬんよりSandyとかivyの頃の価格で4c8tとか4c買えるようになったことが嬉しいわ

794 ：Socket774 ：2018/02/17(土) 18:31:30.26 ID:v6URVFY9M.net

>>790
最適化という意味では、CCX内のコア数を増やした時の方が影響が大きそう。

795 ：Socket774 ：2018/02/17(土) 19:56:22.20 ID:ncnMS2TD0.net

AM4でこれ以上コア増やしてもメモリアクセスボトルネックにならん？

796 ：Socket774 ：2018/02/17(土) 20:05:33.90 ID:TRZ+ZUSZ0.net

下のはmini-ITXで新しいatom4コアだけど、上位モデルで15800円。
10w程度だから用途は違うとはいえ、2200Gならこれよりずっと安くて高性能なのが組めそうね。
https://pc.watch.impress.co.jp/docs/news/1106809.html

797 ：Socket774 ：2018/02/17(土) 20:18:34.43 ID:m5IwP1ODa.net

>>795
だからキャッシュ盛るんだろう
現状のまま12Cにしても7nm換算だと面積半分以下だし余裕はある
コスト次第だけど

798 ：Socket774 ：2018/02/17(土) 20:26:01.99 ID:t9OdPmq40.net

>>792
AMDの7nm商品ではGFとTSMCの両方を使うと翻訳スレで読んだのを思い出したから
TSMCのCoWoSによる6ダイ実装の興産のほうが大きく6コアCCXの可能性は無さそうだなと思いだしてるから6コア推しは控えとく

ま、このままだと前面降参したみたいだから弁明しとくと、もとから4コアなCCXをクローズしての6コアCCXは考えてなく
（元記事がzen2では6/8コアなCCXもあるかもという時点でCCXのコア数を統一する思想ではない）
現4コアなCCXによる商品ラインは維持したまま、より高価な市場を開拓するにはと考えたら
より多くのコアを集積することを前提にCCXを作り直したほうがいいのでは、と考えての6CCX推しだった次第

799 ：Socket774 ：2018/02/17(土) 20:52:26.48 ID:JGnkahGd0.net

TSMCの7nm使うのはGPUって話だろう
APUはどっちかわからないがCPUはGF

800 ：Socket774 ：2018/02/17(土) 20:53:02.96 ID:3hCvDQX6M.net

そういえばcTDPで45Wにできるんだっけ

801 ：Socket774 ：2018/02/17(土) 20:59:27.07 ID:m5IwP1ODa.net

>>798
6ダイとなるとTR/EPYCクラスはソケット仕様の変更が必要になって来るが
どうだろうな
そもそも何故2の冪乗の内、4を多用するかと言えば3本のコネクトで実装出来るからだ
指数関数状に増える組み合わせ爆発と、不均衡なアクセスコスト管理の煩雑性を抑えつつ性能を向上出来る
要は効率が良いから
クロスバも基本的には2の冪乗が効率が良いんだが、PPRに拠ればそうなってない箇所がある
それにCoWoSが必要な程の配線が、その分メリットを出せるかという問題も有る

TSMCってのは恐らくAPUラインの事と予想するけどね
GPU或いはAPUとHBMを接続するソリューションとしてCoWoSを使うのであればそれは十二分な理由になると思う
丁度HBM3と廉価版HBMが出て来る頃合いだろう

802 ：Socket774 ：2018/02/17(土) 20:59:43.13 ID:9921tPOL0.net

6ダイmcmはあり得ない

803 ：Socket774 ：2018/02/17(土) 21:19:24.81 ID:ge6+JYXx0.net

結局のところCCX内部でコアを増やしたとして
最終的なEPYCのマルチスレッドではコアを横断する処理をすることになるのだから
infinity fabricの帯域強化やレイテンシ改善は必須になるだろうし
それをすることを考えたらCCXを増やす方向でも一緒なんじゃないのと思う

804 ：Socket774 ：2018/02/17(土) 21:28:24.55 ID:m5IwP1ODa.net

というかB1に於けるAPIC IDの並びからCCXが増えるので無ければ互換切れるんですけどね

805 ：Socket774 ：2018/02/17(土) 21:34:02.03 ID:5gbJ4cn40.net

>>704
こいつ嫌い

806 ：Socket774 ：2018/02/17(土) 21:37:14.50 ID:m5IwP1ODa.net

>>805
ちょっとわかる

807 ：Socket774 ：2018/02/17(土) 21:37:38.70 ID:t9OdPmq40.net

>>801
だから今、4コアCCXでカバーされてるライン（現Ryzen、現EPYC）の上
HPCや現行EPYCでカバーしきれない市場などを視野にいれた新たなラインを（プラットフォーム・レベルから）作るならということ
別ラインなら昨日話題になったコア識別タグの拡張も同時に行えるしさ
これ書いててむしろ8コアCCXでさらなる上を狙う可能性のほうが（自分の中で）大きくなってきたような気がする

808 ：Socket774 ：2018/02/17(土) 21:41:43.03 ID:m5IwP1ODa.net

>>807
んー
あり得なくは無いけど
パッケージパワーがヤバいことになんない?
軽くvega10クラスかそれ以上行きそうだけど
あとそういう多集積嫌うからこういう構成にしてるのにさ、、、

809 ：Socket774 ：2018/02/17(土) 22:46:31.73 ID:t9OdPmq40.net

>>808
48コア↑を3GHzで動かすとかしなければ大丈夫じゃなかろうか
どうせ48以上の汎用コアを求めるなんてニッチ（だけど商品と性能がマッチすれば高値で売れる）だし

810 ：Socket774 ：2018/02/17(土) 22:50:50.95 ID:m5IwP1ODa.net

>>809
そうなって来るともうCCX構成よりリングバスで良さそうね
Dr.Lisaの経験が猛威振るいそう

811 ：Socket774 ：2018/02/17(土) 23:31:39.95 ID:ydRqfssJM.net

単純に95wやら120wクラスのを出せば、性能上がるんだろ

812 ：Socket774 ：2018/02/17(土) 23:35:08.74 ID:t9OdPmq40.net

>>810
たしかにCCXという形にこだわる必要がなかった・・

813 ：Socket774 ：2018/02/18(日) 09:33:50.48 ID:BCrx1Vrfp.net

“Pinnacle Ridge”は、Integrated heatspreaders (IHS) がソルダリングされたものとなる

https://www.techpowerup.com/241593/amd-ryzen-2000-series-pinnacle-ridge-cpus-get-soldered-ihs

814 ：Socket774 ：2018/02/18(日) 09:38:50.04 ID:BCrx1Vrfp.net

>>795
ソケットAM4ではCPUキャッシュ増やして緩和する。
ZEN3世代の新ソケットではメモリーがDDR5に移行する。

815 ：Socket774 ：2018/02/18(日) 10:46:55.23 ID:PDAYWpuBM.net

4コアccxを4つ集めたものを新たな単位にしよう。
そしてそれを4つ集めたものを新たな…

816 ：Socket774 ：2018/02/18(日) 10:58:09.12 ID:XIAUIuru0.net

Larrabeeかな?

817 ：Socket774 ：2018/02/18(日) 10:59:39.44 ID:tw0+ez9u0.net

>>815
4x4でも14nmで400
では10で200、7で100
当分無理じゃね?
bullコアでやれば、あれ小さいから今でも4x4x4くらいは出来そうだけど

818 ：Socket774 ：2018/02/18(日) 11:47:59.87 ID:UbqtEzqk0.net

Ｚｅｎ+の生産始まってるのかな？
もうとっとと販売開始してほしい

819 ：Socket774 ：2018/02/18(日) 13:07:56.96 ID:oajze6U20.net

メモリは３DになってるんだCPUも縦に積めばおｋだろ

820 ：Socket774 ：2018/02/18(日) 13:09:21.40 ID:ovkwToep0.net

>>819
発熱どうすんねん

821 ：Socket774 ：2018/02/18(日) 13:47:55.50 ID:KaeCetXHM.net

>>796
mini-itxで組む奴は性能やコスパより低TDPにこだわる
intelは捨てたけどTDP45Wでもまだ高いのでとりあえず9800Eで妥協した

822 ：Socket774 ：2018/02/18(日) 13:50:40.54 ID:/ii+3rdt0.net

9800E@35Wより2200G@45Wのほうが消費電力低いと思うが
それか2200GE待ってもいい

823 ：Socket774 ：2018/02/18(日) 13:54:19.83 ID:G4PhVnFJ0.net

cTDPはアテにならないよ
KaveriのころはcTDP45Wにしても
最初から45Wの6700Tよりも消費電力が高めだった
同じぐらいの性能なら20Wとかでも出せそうだけど
そこまで下げられないしね

824 ：Socket774：2018/02/18(日) 14:02:34.94 .net

cTDPはモバイル用の機能だから消費電力でイコールだから正確だよ
熱状態でTurboするTDPが瞬電が出てオーバーする

825 ：Socket774 ：2018/02/18(日) 14:07:33.01 ID:G4PhVnFJ0.net

cTDPにしたところで最大のターボクロックは変わらないから
平均は45Wでも瞬間が高めなのは当たり前

826 ：Socket774 ：2018/02/18(日) 14:07:48.67 ID:G4PhVnFJ0.net

cTDPにしたところで最大のターボクロックは変わらないから
平均は45Wでも瞬間が高めなのは仕方がない

827 ：Socket774 ：2018/02/18(日) 14:10:59.48 ID:G4PhVnFJ0.net

内容が重複した(´・ω・`)
それよりもcTDP時の通常クロック

828 ：Socket774 ：2018/02/18(日) 14:12:57.40 ID:G4PhVnFJ0.net

分かりづらいのと
リミットでCPUとGPUが動いた時の挙動が怪しくなるのが問題

829 ：Socket774 ：2018/02/18(日) 14:17:28.24 ID:Nzqj6rqda.net

もちつけ

830 ：Socket774 ：2018/02/18(日) 15:38:21.23 ID:QhlJq+Jb0.net

ぺったんぺったん

831 ：Socket774 ：2018/02/18(日) 15:41:10.59 ID:JchpplMw0.net

つるぺったん

832 ：Socket774 ：2018/02/18(日) 18:21:03.29 ID:feKBMhXAM.net

Sandyの2600からRyzenの2600に乗り換えるのがちょっと流行ると思う

833 ：Socket774 ：2018/02/18(日) 19:33:09.66 ID:Ib2PRoXmp.net

　　　　　　　 ｒｰ､
　　　　｣´￣｀ｌｰ) ＼
　　　　Ｔ¨Ｌ　|_/⌒/　← AMD入れてた奴
　　　　 ｀レ￣｀ヽ〈
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　　　　　_ゝ_／ ノ
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834 ：Socket774 ：2018/02/18(日) 20:31:33.33 ID:qFs7kf2q0.net

>>833
これ毎回思うが、IntelからRyzenに乗り換えたヤツ以外は負け組だろ

835 ：Socket774 ：2018/02/18(日) 21:09:31.97 ID:5Re/XGzX0.net

AMD3機Intel2機だわ